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概览

描述

Low skew, low jitter PLL clock driver; 1 to 5 differential clock distribution (SSTL_18)

特性

  • Feedback pins for input to output synchronization
  • Spread Spectrum tolerant inputs
  • Auto PD when input signal is at a certain logic state

产品对比

应用

文档

类型 文档标题 日期
数据手册 PDF 329 KB
EOL 通告 PDF 160 KB
EOL 通告 PDF 549 KB
EOL 通告 PDF 545 KB
EOL 通告 PDF 544 KB
产品变更通告 PDF 398 KB
6 items

设计和开发

模型

ECAD 模块

点击产品选项表中的 CAD 模型链接,查找 SamacSys 中的原理图符号、PCB 焊盘布局和 3D CAD 模型。如果符号和模型不可用,可直接在 SamacSys 请求该符号或模型。

Diagram of ECAD Models

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