特性
- Low skew, low jitter PLL clock driver
- Feedback pins for input to output synchronization
- Spread Spectrum tolerant inputs
- With bypass mode mux
- Operating frequency 60 to 210 MHz
- Universal input (LVTTL, LVPECL, LVDS, LVCMOS)
描述
Not recommended for new designs
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Temp. Grade | Pb (Lead) Free | Carrier Type |
|---|---|---|---|---|---|---|---|---|
| 95V850AG | Obsolete | N/A | Out of Stock | TSSOP | 48# | C | No | Tube |
| 95V850AGLF | Obsolete | N/A | Out of Stock | TSSOP | 48# | C | Yes | Tube |
| 95V850AGLFT | Obsolete | N/A | Out of Stock | TSSOP | 48# | C | Yes | Reel |
| 95V850AGT | Obsolete | N/A | Out of Stock | TSSOP | 48# | C | No | Reel |
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