特性
- Supports output clock frequencies up to 400 MHz
- 4 Selectable SMBus addresses
- SMBus address is independent of PLL operating mode
- Dedicated CKPWRGD/PD# and VDDA pins ease board design
描述
The IDT9EX21501 provides 15 output clocks for PCIe Gen2 (100MHz) or QPI (133MHz) applications. The 9EX21501 has 4 selectable SMBus addresses, and dedicated CKPWRGD/PD# and VDDA pins for easy board design. A differential CPU clock from a CK410B+ main clock generator, such as the IDT932S421, drives the IDT9EX21501. In fanout mode, the 9EX21501 provides outputs up to 400MHz.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Power Consumption Typ (mW) | Qty. per Reel (#) | Qty. per Carrier (#) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 9EX21501AKILF | Obsolete | N/A | Out of Stock | VFQFPN | 64# | Tray | 3 | 1396mW | 0 | 207# | Yes | e3 Sn | -40 to 85°C |
| 9EX21501AKILFT | Obsolete | N/A | Out of Stock | VFQFPN | 64# | Reel | 3 | 1396mW | 3000# | 0 | Yes | e3 Sn | -40 to 85°C |
| 9EX21501AKLF | Obsolete | N/A | In Stock | VFQFPN | 64# | Tray | 3 | 1106mW | 0 | 207# | Yes | e3 Sn | 0 to 70°C |
| 9EX21501AKLFT | Obsolete | N/A | Out of Stock | VFQFPN | 64# | Reel | 3 | 1106mW | 3000# | 0 | Yes | e3 Sn | 0 to 70°C |
- 应用说明英语PDF 495 KB 7WDXRDKU4E7E-5-57312 2014年5月12日
- EOL 通告英语PDF 606 KB 7WDXRDKU4E7E-5-62524 2017年11月29日
- 产品变更通告英语PDF 583 KB 7WDXRDKU4E7E-5-61343 2016年12月20日
- 产品变更通告英语PDF 95 KB 7WDXRDKU4E7E-5-59609 2015年10月22日
- 产品变更通告英语PDF 50 KB 7WDXRDKU4E7E-5-59245 2015年7月21日
推荐文档 (1)
数据手册 (1)
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
应用说明和白皮书 (8)
- EOL 通告英语PDF 606 KB 7WDXRDKU4E7E-5-62524 2017年11月29日
- 产品变更通告英语PDF 583 KB 7WDXRDKU4E7E-5-61343 2016年12月20日
- 产品变更通告英语PDF 95 KB 7WDXRDKU4E7E-5-59609 2015年10月22日
- 产品变更通告英语PDF 50 KB 7WDXRDKU4E7E-5-59245 2015年7月21日查看更多 (7)
产品通告（产品变更、EOL 等） (7)
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
营销资料 (1)
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
No Results Found.
确保所有关键词拼写正确。
尝试使用更少、不同或更宽泛的词语来改变搜索结果。
如果您使用了筛选器，请考虑取消选择某些筛选器选项以扩大搜索结果。
- 搜索我们丰富的知识库，帮助您解答常见问题
- 前往支持论坛，获取瑞萨电子技术专家和社群的帮助
This is the first video in our PCIe series. In this video, we define PCIe architectures, focusing on common and separate clock architectures. Watch the rest of the video series below where Ron will cover the impact of different timing architectures.
In this episode, Ron Wade from IDT (acquired by Renesas) explains PCIe common clocking and its impact on timing solutions. Learn about using a single clock source, fan-out buffers, and the considerations for spread spectrum and non-spread spectrum clocking in PCIe systems.
In this video, we explore PCIe with separate reference clocks and the effects of clock selection. Learn how separate reference clocks work and their impact on system performance and stability.
This video provides a high-level overview of Separate Reference Clock with Independent Spread (SRIS) architectures for PCI Express systems, additional performance requirements that this clocking architecture imposes on the reference clocks, and some system implications encountered trying to implement the architecture.
