特性
- One differential LVDS output
- Crystal oscillator interface designed for 18pF, 25MHz parallel resonant crystal
- VCO range: 490MHz - 680MHz
- RMS phase jitter at 100MHz (12kHz - 20MHz): 0.792ps (typical)
- RMS phase jitter at 125MHz (12kHz - 20MHz): 0.773ps (typical)
- Full 3.3V output supply mode
- PCI Express (2.5 Gb/s) and Gen 2 (5 Gb/S) jitter compliant
- 0°C to 70°C ambient operating temperature
- Available in lead-free (RoHS 6) package
描述
The 844201-45 is a PCI Express® Clock Generator. The 844201-45 can synthesize 100MHz or 125MHz reference clock frequencies with a 25MHz crystal. The 844201-45 has excellent phase jitter performance and is packaged in a small 8-pin TSSOP, making it ideal for use in systems with limited board space.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Qty. per Reel (#) | Qty. per Carrier (#) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 844201BG-45LF | Obsolete | N/A | Out of Stock | TSSOP | 8# | Tube | 1 | 0 | 96# | Yes | e3 Sn | 0 to 70°C |
| 844201BG-45LFT | Obsolete | N/A | Out of Stock | TSSOP | 8# | Reel | 1 | 2500# | 0 | Yes | e3 Sn | 0 to 70°C |
- 应用说明英语PDF 495 KB 7WDXRDKU4E7E-5-57312 2014年5月12日
- 应用说明英语PDF 136 KB 7WDXRDKU4E7E-5-57044 2014年3月12日
推荐文档 (1)
数据手册 (1)
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应用说明和白皮书 (20)
- 产品变更通告英语PDF 611 KB 7WDXRDKU4E7E-5-60321 2016年4月14日
- 产品变更通告英语PDF 611 KB 7WDXRDKU4E7E-5-59927 2016年2月15日
- 产品变更通告英语PDF 596 KB 7WDXRDKU4E7E-5-59884 2016年1月28日查看更多 (8)
产品通告（产品变更、EOL 等） (8)
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This is the first video in our PCIe series. In this video, we define PCIe architectures, focusing on common and separate clock architectures. Watch the rest of the video series below where Ron will cover the impact of different timing architectures.
In this episode, Ron Wade from IDT (acquired by Renesas) explains PCIe common clocking and its impact on timing solutions. Learn about using a single clock source, fan-out buffers, and the considerations for spread spectrum and non-spread spectrum clocking in PCIe systems.
In this video, we explore PCIe with separate reference clocks and the effects of clock selection. Learn how separate reference clocks work and their impact on system performance and stability.
This video provides a high-level overview of Separate Reference Clock with Independent Spread (SRIS) architectures for PCI Express systems, additional performance requirements that this clocking architecture imposes on the reference clocks, and some system implications encountered trying to implement the architecture.
