特性
- 48 PCIe Gen1 Lanes, 12 Switch Ports
- Non-blocking switch architecture optimized for High Performance System Interconnect
- Partionable switch architecture for true multi-root support
- Internal buffering and flow control credits optimized for maximum bandwidth and large payloads
- Low latency, Low power
89HPES48H12 - Block Diagram
描述
Provides 48 PCIe lanes and 12 ports of high-performance, deterministic system interconnect switching. All ports receive full line rate, non-blocking throughput for multiple traffic flows regardless of switch loading.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Temp. Grade | Pb (Lead) Free | Carrier Type |
|---|---|---|---|---|---|---|---|---|
| 89HPES48H12ZABL | Obsolete | N/A | Out of Stock | FCBGA | 1156# | C | No | Tray |
| 89HPES48H12ZABLI | Obsolete | N/A | Out of Stock | FCBGA | 1156# | I | No | Tray |
| 89HPES48H12ZABR | Obsolete | N/A | Out of Stock | FCBGA | 1156# | C | No | Tray |
| 89HPES48H12ZABRI | Obsolete | N/A | Out of Stock | FCBGA | 1156# | I | No | Tray |
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