特性
- Low skew, low jitter PLL clock driver
- Max frequency supported = 400MHz (DDRII 800)
- I2C for functional and output control
- Feedback pins for input to output synchronization
- Spread Spectrum tolerant inputs
- Programmable skew through SMBus
- Frequency defect control through SMBus
- Individual output control programmable through SMBus
描述
DDR I/DDR II Phase Lock Loop Zero Delay Buffer
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Qty. per Reel (#) | Qty. per Carrier (#) | Package Area (mm²) | Pkg. Dimensions (mm) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 9P935AFLF | Obsolete | N/A | In Stock | SSOP | 28# | Tube | 1 | 0 | 47# | 54.1mm² | 10.2 x 5.3 x 1.73 | Yes | e3 Sn | 0 to 70°C |
| 9P935AFLFT | Obsolete | N/A | In Stock | SSOP | 28# | Reel | 1 | 1500# | 0 | 54.1mm² | 10.2 x 5.3 x 1.73 | Yes | e3 Sn | 0 to 70°C |
| 9P935AGLF | Obsolete | N/A | Out of Stock | TSSOP | 28# | Tube | 1 | 0 | 50# | 42.7mm² | 9.7 x 4.4 x 1.0 | Yes | e3 Sn | 0 to 70°C |
| 9P935AGLFT | Obsolete | N/A | Out of Stock | TSSOP | 28# | Reel | 1 | 2000# | 0 | 42.7mm² | 9.7 x 4.4 x 1.0 | Yes | e3 Sn | 0 to 70°C |
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