特性
- Optimized for 2.5V LVTTL
- Guaranteed Low Skew < 25ps (max)
- Very low duty cycle distortion < 300 (max)
- High speed propagation delay < 1.8ns. (max)
- Up to 200MHz operation
- Very low CMOS power levels
- Hot insertable and over-voltage tolerant inputs
- 1:5 fanout buffer
- 2.5V VDD
- Available in TSSOP package
5T9050 - Block Diagram
描述
The 5T9050 2.5V single data rate (SDR) clock buffer is a single-ended input to five single-ended outputs buffer built on advanced metal CMOS technology. The SDR clock buffer fanout from a single input to five single-ended outputs reduces the loading on the preceding driver and provides an efficient clock distribution network. Multiple power and grounds reduce noise.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Qty. per Reel (#) | Qty. per Carrier (#) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 5T9050PGGI | Obsolete | N/A | In Stock | TSSOP | 28# | Tube | 1 | 0 | 50# | Yes | e3 Sn | -40 to 85°C |
| 5T9050PGGI8 | Obsolete | N/A | In Stock | TSSOP | 28# | Reel | 1 | 2000# | 0 | Yes | e3 Sn | -40 to 85°C |
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