特性
- Packaged in 16-pin TSSOP
- Pb (lead) free package
- Operating voltage of 3.3 V
- Low power consumption
- Input clock frequency of up to 200 MHz
描述
The 557-08 is a 2:1 multiplexer chip that allows the user to select one of the two HCSL (Host Clock Signal Level) input pairs and fans out to one pair of differential HCSL or LVDS outputs. This chip is suited especially for PCI-Express applications, where there is a need to select the PCI-Express clock either locally from the PCI-E card or from the motherboard.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Qty. per Reel (#) | Qty. per Carrier (#) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| 557G-08LF | Obsolete | N/A | In Stock | TSSOP | 16# | Tube | 1 | 0 | 96# | Yes | e3 Sn | 0 to 70°C |
| 557G-08LFT | Obsolete | N/A | In Stock | TSSOP | 16# | Reel | 1 | 2500# | 0 | Yes | e3 Sn | 0 to 70°C |
| 557GI-08LF | Obsolete | N/A | In Stock | TSSOP | 16# | Tube | 1 | 0 | 96# | Yes | e3 Sn | -40 to 85°C |
| 557GI-08LFT | Obsolete | N/A | In Stock | TSSOP | 16# | Reel | 1 | 2500# | 0 | Yes | e3 Sn | -40 to 85°C |
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数据手册 (1)
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应用说明和白皮书 (11)
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产品通告（产品变更、EOL 等） (9)
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This is the first video in our PCIe series. In this video, we define PCIe architectures, focusing on common and separate clock architectures. Watch the rest of the video series below where Ron will cover the impact of different timing architectures.
In this episode, Ron Wade from IDT (acquired by Renesas) explains PCIe common clocking and its impact on timing solutions. Learn about using a single clock source, fan-out buffers, and the considerations for spread spectrum and non-spread spectrum clocking in PCIe systems.
In this video, we explore PCIe with separate reference clocks and the effects of clock selection. Learn how separate reference clocks work and their impact on system performance and stability.
This video provides a high-level overview of Separate Reference Clock with Independent Spread (SRIS) architectures for PCI Express systems, additional performance requirements that this clocking architecture imposes on the reference clocks, and some system implications encountered trying to implement the architecture.
